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C'est marrant j'y pensais justement cette semaine !
Il faut généraliser ça.
vivado c'est pire que microsoft ... ça fait 6 ans que le bug est connu et signalé par les utilisateurs. Malgré cela Xilinx s'évertue à le reproduire dans ses nouvelles version de logiciels !
Mon workaround :
$ cd /opt/Xilinx/Vivado/2017.1/ids_lite/ISE/lib/lin64
$ mv libstdc++.so.6 libstdc++.so.6.bak
$ ln -s /lib/x86_64-linux-gnu/libstdc++.so.6
Très bon !
Les interfaces des ordinateurs d'aujourd'hui sont plus lentes que les interfaces d'hier ...
Et pas qu'un peu !
Les russes sont très loin devant maintenant.
Je suis superphenix
Génial !
Vers l'infini et au delà ! Bientôt la synthèse libre pour Xilinx.
Le projet de reverse-engineering des FPGA Xilinx de la série 7. Par les auteurs de IceStorm -> projet de reverse engineering des FPGA ICE40 de Lattice.
La vidéo et les slide du 34c3
Le zynq reversé !
C'est la chute !
Cool un nouveau S.O.S bonheur. Sans vanhamme cette fois