VHDL

Voici les outils libres permettant de travailler avec du VHDL.

  • GHDL: Basé sur Gcc permet de simuler du VHDL.
  • nvc:  Basé sur LLVM permet de simuler du VHDL
  • FreeHDL: Module du projet Qucs pour simuler du VHDL
  • VerilatorVHDL: un fork de verilator permettant de convertir des modèle VHDL synthétisable en objet C++/SystemC permettant d’accélérer la simulation.

Documents

  • IEEE_1076.6 : Le standard IEEE sur la partie synthétisable du VHDL.

Web

  • Surf-VHDL: un bon blog bourré d’articles tutoriel pour apprendre le VHDL du testbench à la synthèse.

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